通用型高速LDPC码编码器设计与FPGA实现

作     者：陈全坤 杨奇 李二保 雷菁 

作者机构：国防科学技术大学电子科学与工程学院湖南长沙410073 中国人民武装警察8645部队河北石家庄050800 西北工业大学电子信息学院陕西西安710072 

基　　金：国家自然科学基金项目(61501479) 

出 版 物：《数字技术与应用》 (Digital Technology & Application)

年 卷 期：2016年第34卷第5期

页      码：146-148页

摘      要：随着高速数据传输业务的快速发展,人们对信息传输的质量和速率要求越来越高,高速LDPC码编译码器在通信系统中的应用需求更加强烈。在节约硬件资源的前提下,为最大限度的降低编码时延、提高编码器速率,本文从编码算法的通用性出发,将一致校验矩阵通过行列置换和高斯消元,使每个校验位的运算只与预处理后矩阵的对应行相关,具备了可以灵活并行处理的结构。在编码器的硬件设计上,本文提出了一种校验位并行分步运算的编码器架构,通过同时计算所有校验位,分步处理单个校验位,有效地降低了硬件实现复杂度,缩短了关键路径时延,提高了编码速率。实现结果表明,本文设计和实现的编码器工作时钟频率可以达到250MHz,相应的吞吐量为14Gbit/s。

主 题 词：通用型 LDPC码 高速编码器 

学科分类：080903[080903] 0809[工学-计算机类] 08[工学] 0812[工学-测绘类] 

D　O　I：10.19695/j.cnki.cn12-1369.2016.05.103

馆 藏 号：203166990...