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并行加法器的研究与设计
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《晋中师范高等专科学校学报》2003年 第4期20卷 330-334页
作者：安印龙 许琪 杨银堂航天部七七一所陕西西安710054 西安电子科技大学陕西西安710071 
首先介绍了常用并行加法器的设计方法,并在此基础上采用带进位强度的跳跃进位算法,通过逻辑综合和布局布线设计出了一个加法器。分析和比较表明,该加法器不仅速度快于超前进位加法器,而且面积和功耗均小于超前进位加法器。
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