摘要：本文介绍一种基于FPGA的B超前端发射和回波接收放大部分的电路设计方案。FPGA主要用于对发射高压多路电子开关、接收模拟矩阵电子开关的控制和数字化发射延时聚焦等控制的实现。

摘要：基于SMIC的0.25μm工艺设计了一种输出频率范围为0.32～1.6GHz的电荷泵锁相环频率合成器电路.该电路采用了一种快速鉴频鉴相器和含有双交叉耦合结构的环形振荡器,同时根据电荷泵泵电流匹配的原则改进了电荷泵电路.HSIM仿真显示,锁相环频率合成器的锁定时间为1.3μs,功耗为28mW,锁定范围为5～20MHz,最大周对周抖动仅为50ps(0.8GHz).

摘要：文章在CSMC 0.5μm/5V硅CMOS工艺模型下,设计了一种用于电表计量芯片的全差分运算放大器。该运放采用两级结构,其中第一级为折叠式共源共栅结构,第二级为PMOS输出缓冲结构。文章采用开关电容技术实现共模反馈以稳定输出共模电压,跟传统方法相比,这将能降低芯片面积及降低功耗。采用HSPICE软件对该电路进行仿真,仿真结果表明在负载电容为2pF情况下,该运算放大器具有开环增益为84.7dB、单位增益带宽达44.8MHz、相位裕度为67°、闭环小信号建立时间为39ns。