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一种改进Turbo码译码器的FPGA设计与实现: 收藏
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引用; 《电子技术应用》2008年第3期34卷 32-35页; 作者：赵旦峰罗清华焉晓贞哈尔滨工程大学信息与通信工程学院黑龙江哈尔滨150001; 提出了一种基于MAX-Log-MAP算法的更有效减小译码延时的方法,通过并行计算前向状态度量和后向状态度量,将半次迭代译码延时缩短一半,而译码性能没有损失,同时也减小了硬件实现中的时序控制复杂度。仿真表明,该方法有效降低了译码的延时...; 提出了一种基于MAX-Log-MAP算法的更有效减小译码延时的方法,通过并行计算前向状态度量和后向状态度量,将半次迭代译码延时缩短一半,而译码性能没有损失,同时也减小了硬件实现中的时序控制复杂度。仿真表明,该方法有效降低了译码的延时,并且性能没有损失,具有较高的实用价值。; 来源：详细信息评论

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