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基于Innovus提升芯片性能的物理实现方法: 收藏
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引用; 《电子技术应用》2019年第8期45卷 48-52,60页; 作者：边少鲜 David He 栾晓琨蒋剑锋翟飞雪蔡准天津飞腾信息技术有限公司湖南长沙410000 上海楷登电子科技有限公司上海201204; 对于规模日益增大,工作频率不断增加的高性能芯片设计,性能一直是物理设计的重点和难点。缓冲器的插入是为了最小化信号线延时,进而优化时序,提升性能。描述了使用CadenceInnovus工具建立物理设计流程,减少各步骤间的偏差。同时在此流...; 对于规模日益增大,工作频率不断增加的高性能芯片设计,性能一直是物理设计的重点和难点。缓冲器的插入是为了最小化信号线延时,进而优化时序,提升性能。描述了使用CadenceInnovus工具建立物理设计流程,减少各步骤间的偏差。同时在此流程的基础上提出二次布局优化方法,在16nm下,通过一个高性能芯片设计验证了该流程与方法,实例结果表明,设计性能得到很大改善,其中时序优化达85.07%,该流程及方法可有效提升高性能芯片性能。; 来源：详细信息评论

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