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基于FPGA的双乘法器卷积加速算子的封装方法
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《计算机工程与设计》2022年 第8期43卷 2385-2392页
作者：聂煜桐 沈月峰 杨帆 王吕大中国航天科工集团第二研究院七〇六所北京100854 
FPGA因其灵活性、高并行性和可定制性,在卷积神经网络的加速中表现出良好的性能。实践中通常会将卷积的乘加运算交付给FPGA的DSP块,因此DSP的使用效率会直接影响加速器的性能。将两个乘法操作封装到一个DSP块可以同时提高DSP资源的利用...
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