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Viterbi译码器的FPGA设计实现与优化: 收藏
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引用; 《西安工程科技学院学报》2005年第1期19卷 75-78页; 作者：魏忠义覃祥菊西安工程科技学院电子信息学院陕西西安710048; 在分析Viterbi译码算法基础上,采用一种新的流水结构设计Viterbi译码器的ACS模块.合理安排幸存路径的读写,采用单指针回溯算法译码输出,最终在XilinxISE上完成了约束长度为9的Viterbi译码器的FPGA设计.仿真实验结果表明,设计的译码器在...; 在分析Viterbi译码算法基础上,采用一种新的流水结构设计Viterbi译码器的ACS模块.合理安排幸存路径的读写,采用单指针回溯算法译码输出,最终在XilinxISE上完成了约束长度为9的Viterbi译码器的FPGA设计.仿真实验结果表明,设计的译码器在资源消耗上有较大优势.; 来源：详细信息评论

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