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双闹钟数字时钟芯片设计: 收藏
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引用; 《现代电子技术》2004年第9期27卷 4-5,7页; 作者：卢雪萍刘莎马骏杭州电子工业学院ICCAD研究所浙江杭州310037; 简述了一种双闹钟数字时钟芯片的设计分析 ,具体介绍了其中三态输入电路、可逆计数器、输出解码 /驱动器等电路的设计。这种数字时钟芯片用途广泛 ,外围电路简单 ,并可以选择利用电网的 5 0 /60 Hz作为频率基准和电源 ,适用于数字钟、...; 简述了一种双闹钟数字时钟芯片的设计分析 ,具体介绍了其中三态输入电路、可逆计数器、输出解码 /驱动器等电路的设计。这种数字时钟芯片用途广泛 ,外围电路简单 ,并可以选择利用电网的 5 0 /60 Hz作为频率基准和电源 ,适用于数字钟、钟控收音机产品的应用。; 来源：详细信息评论

双闹钟数字时钟电路的设计: 收藏
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引用; 《电子元器件应用》2004年第8期6卷 24-26页; 作者：卢雪萍刘莎马骏杭州电子科技大学IC-CAD研究所浙江杭州310037; 简述一种双闹钟数字时钟电路的设计,具体介绍其中三态输入电路、可逆计数器和输出解码/驱动器等电路的设计。这种数字时钟电路的用途广泛,外围电路简单,并可选择利用电网的50Hz/60 Hz作为频率基准的电源,适用于数字钟、钟控收音机产品...; 简述一种双闹钟数字时钟电路的设计,具体介绍其中三态输入电路、可逆计数器和输出解码/驱动器等电路的设计。这种数字时钟电路的用途广泛,外围电路简单,并可选择利用电网的50Hz/60 Hz作为频率基准的电源,适用于数字钟、钟控收音机产品的应用。; 来源：详细信息评论

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