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ASIC芯片中BFD定时器协商机制改进设计与实现: 收藏
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引用; 《软件导刊》2013年第8期12卷 26-28页; 作者：蒋建锋蒋建峰孙金霞苏州工业园区服务外包职业学院江苏苏州215123; 描述了在电信级以太网芯片中实现BFD快速检测与定时器协商机制的逻辑设计过程,并将硬件逻辑在FPGA仿真芯片中进行了验证。验证了单纯硬件逻辑实现BFD定时器协商机制的可行性,该机制使用软硬件联合设计的改进方法,能够在节约硬件资源的...; 描述了在电信级以太网芯片中实现BFD快速检测与定时器协商机制的逻辑设计过程,并将硬件逻辑在FPGA仿真芯片中进行了验证。验证了单纯硬件逻辑实现BFD定时器协商机制的可行性,该机制使用软硬件联合设计的改进方法,能够在节约硬件资源的前提下,发挥硬件的速度优势和软件的灵活优势,实现可靠的BFD时间协商过程与快速检测机制。此改进设计经过使用软件和硬件的联合验证,结果表明能够达到预期的效果,并能够实现商业应用。; 来源：详细信息评论

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