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1553B总线协议IP核设计与实现
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《电子器件》2007年 第1期30卷 334-338页
作者：周密 金惠华 尚利宏 李化云北京航空航天大学601教研室北京100083 
介绍了自主知识产权的1553B总线IP核的系统结构、实现方法与容错设计.IP核使用Verilog语言设计,可在10万等效门以上的现场可编程逻辑芯片上实现.其他自行研制的1553B解决方案均建立在嵌入式处理器或DSP基础上,其协议芯片仅完成数据链路...
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