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一种折叠内插式高速模数转换器的设计
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《信息技术》2007年 第5期31卷 17-21页
作者：刘斌乙 戎蒙恬 郑晔鑫上海交通大学芯片与系统研究中心上海200240 
描述了一种8bit,125MS/s采样率的折叠内插式ADC采用折叠内插结构设计。系统采用全并行结构的粗量化器实现高3位的量化编码,细量化部分采用折叠内插结构实现低5位的量化编码。电路设计中涉及分布式采样保持电路、折叠内插电路并在文章最...
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