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FMCW雷达水位计设计
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《机械设计与制造》2018年 第3期 178-181页
作者:逯继业 武利生 赵达森太原理工大学机械工程学院山西太原030024 
选用调频连续波(FMCW)雷达传感器IVS-179,设计了一种以TMS320F28335作为DSP核心芯片的雷达水位计。设计了水位计硬件电路并重点介绍了波形发生器及信号处理模块中可编程滤波放大电路的实现,采用温度传感器矫正测量距离、串口通讯传递数...
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基于隧道新风量需求的活塞风井方案特性研究
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《铁道标准设计》2019年 第10期63卷 111-117页
作者:史柯峰 刘垚 张越 李晓锋中交铁道设计研究总院有限公司北京100088 清华大学建筑学院北京100084 
以某市域铁路工程为例,通过采用一维数值模拟方法建立模型,对该工程中某一独立地下站设置单、双活塞风井不同方案时的地下区间隧道有效新风量进行分析与研究,在进行隧道新风量模拟计算结果判定与数据拟合的同时,也对影响区间隧道新风量...
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高程差传感器信号处理
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《传感器与微系统》2010年 第6期29卷 87-88,94页
作者:朱洪涛 钟爱平南昌大学机电工程学院江西南昌330031 
介绍了一种以液体为介质来传递压力的新型高程差传感器信号处理方法。采用仪表放大器构成信号的前置放大处理电路,设计了基于压差测量的高程差传感器的信号调理电路,完成放大、滤波等功能,同时采用硬件和软件相结合的方式对数据进行处理...
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边缘检测法在线阵CCD中的应用
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《传感器与微系统》2013年 第8期32卷 149-152页
作者:瞿仕波 周炎涛湖南大学电气与信息工程学院湖南长沙410082 
根据工业、交通等领域对于非接触测量越来越高的精度需求,采用先进的线阵耦合器件(CCD)和复杂可编程逻辑器件(CPLD)技术,设计了一种用于实现高精度边缘检测的系统。系统将一维视频信号的噪声通过滤波技术、相关双采样技术进行消除,经A/...
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一种自适应训练的BP神经网络FPGA设计
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《现代电子技术》2016年 第15期39卷 115-118页
作者:王蒙 常胜 王豪武汉大学物理科学与技术学院湖北武汉430072 
为解决软件实现神经网络存在并行度不高、速度慢的缺点以及传统神经网络硬件设计资源利用高、网络训练不可控的不足,提出了一种新的BP神经网络FPGA设计方法。该方法通过基于对称性的分段线性拟合和非线性拟合实现Sigmoid激励函数和利用...
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东方红拖拉机电控液压转向系统设计及试验研究
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《农机化研究》2016年 第11期38卷 246-251页
作者:黎永键 赵祚喜 高俊文 吴晓鹏广东农工商职业技术学院广州510507 华南农业大学工程学院广州510642 
为实现农业机械自动导航,在东方红-X804拖拉机平台上设计了电控液压转向系统。首先阐述了系统整体设计方案,介绍了系统的组成及工作原理;针对系统非线性特性,采用双闭环控制方法,解析了控制原理。同时,对该系统进行动态分析,推导建立了...
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无线传感器网络(WSN)支架压力监测数据自适应拟合方法
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《煤矿机电》2019年 第1期40卷 61-63页
作者:张杰文国能集团宁夏煤业集团公司宁夏银川751409 
无线传感器网络用于支架压力监测已受到越来越多的重视,对此提出采用支架压力数据的自适应拟合方法来有效地压缩传输数据,以提高节点的生存期。按压力数据变化的奇异性,设计了自适应分段线性拟合,传输中只传输拟合系数,而不是传输数据本...
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相对密实度对沈阳砾砂峰值强度影响
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《辽宁工程技术大学学报(自然科学版)》2017年 第6期36卷 609-613页
作者:陈晨中国建筑东北设计研究院有限公司辽宁沈阳110003 
为研究土体扰动过程中相对密实度与峰值强度的关系,针对沈阳地区砾砂,分别对不同相对密实度重塑样进行不同围压下的三轴固结排水剪切试验,得到砾砂Duncan-Chang模型的相关参数.随后,探讨了沈阳地区砾砂的峰值强度受相对密实度D_r的影响...
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基于角度和深度的无机植筋承载力试验研究
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《工业建筑》2019年 第2期49卷 168-173,71页
作者:尚守平 黄新中 畅永康 杨甜湖南大学土木工程学院长沙410082 广东省建筑设计研究院广州510000 
目前植筋工程中多为非水平面的植筋,而关于植筋锚固的试验研究多局限于水平面,其他角度(如90°,135°,180°)的植筋锚固性能尚未涉及。针对这一现状,通过混凝土框架不同角度基材面上的植筋拉拔试验,归纳出两种典型的破坏模...
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高精度DDS数字IP核的设计
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《电子器件》2017年 第6期40卷 1456-1458页
作者:张科新 余建常州信息职业技术学院电子与电气工程学院江苏常州213164 
为了满足雷达系统对高精度DDS(直接数字式频率合成器)的需求,综合使用查表法、复数旋转和线性拟合3种方法,提高DDS输出信号的无杂散动态范围SFDR。当相位累加器为24bit时,使用小于1 kbyte的ROM。仿真表明所设计的DDS,输出信号的SFDR大于...
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