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Viterbi译码器的优化设计
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《电讯技术》2005年 第3期45卷 159-161页
作者：袁金仕 卢焕章国防科技大学ATR实验室湖南长沙410073 
Viterbi译码算法用FPGA实现时,其硬件资源消耗与译码速度始终是相互制约的两个方面,通过合理安排ACS单元和路径度量存储单元可有效缓解这两方面的矛盾。本文以(2,1,6)卷积码为例,基于基4算法提出的动态路径度量存储管理方法能在不影响...
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