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一种增强Verilog建模能力的编译预处理器
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《计算机工程与应用》2006年 第17期42卷 111-113,122页
作者：徐晨 蒋华 袁红林南通大学江苏省ASIC设计重点实验室江苏南通226007 东南大学集成电路学院南京210096 南通大学电子信息学院江苏南通226007 
文章讨论了一种增强Verilog硬件描述语言建模能力的编译预处理器的设计问题。VerilogHDL是专用集成电路设计中应用广泛的一种硬件描述语言,它尚存在一些缺陷。编译预处理器的功能是增强数字系统设计中对模块输入输出端口阵列等参数化设...
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