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基于Verilog HDL的微处理器ALU运算流水线设计
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《数字技术与应用》2014年 第4期32卷 159-160页
作者：庞琳琳 蔡冬玲 冯刚天津物产国际物流有限公司天津300384 重庆科创职业学院重庆402160 
本文使用硬件描述语言Verilog HDL设计了一个ALU运算流水线,包括接口、FIFO模块、ALU模块和测试环境等,有助于提高微处理器的运算效率,为通过先进的描述手段设计微处理器打下良好的基础。
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